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Der Verein KuBI e.V. und die Fachhochschule Dortmund haben eine Studie erstellt, die folgende Fragen beantworten soll: Wie ausgeprägt ist die Risikoneigung von Gewerbetreibenden/Freiberuflern in Deutschland? Wie ausgeprägt ist die Risikowahrnehmung von Gewerbetreibenden/Freiberuflern in Deutschland in Bezug auf typische Gewerberisiken? Welche Beratungs- und Betreuungsangebote erhalten Gewerbetreibende/Freiberufler derzeit? Welchen Versicherungsschutz haben Gewerbetreibende/Freiberufler abgeschlossen?
Ziele der Studie sind:
- Status quo und erste Erfahrungen des großflächigen, durch die Pandemie erzwungenen Wechsels der Beschäftigten der Versicherungsbranche ins Homeoffice ermitteln,
- Die Frage beantworten, ob sich Homeoffice grundsätzlich bewährt hat, inwieweit sich die Einstellungen der Mitarbeiter und der Führungskräfte verändert haben, und welche Handlungsfelder sich für die Mitbestimmung der Arbeitnehmer ergeben.
- Fokus der Studie ist die berufliche Tätigkeit in privaten Wohnräumen der Beschäftigten, üblicher-weise als Homeoffice oder Telearbeit bekannt, in Abgrenzung zum stationären Arbeiten in einem Büro des Arbeitgebers sowie dem mobilen Arbeiten an wechselnden Einsatzorten.
- Die Relevanz ergibt sich aus dem Corona-Pandemie-bedingten sprunghaften Anstieg der Arbeits-zeitanteile, die zwangsweise oder freiwillig zuhause statt in einem Büro des Arbeitgebers er-bracht werden mussten, um allgemein Infektionsketten zu unterbrechen, Pandemie-bedingte Be-triebsschließungen zu vermeiden und die Beschäftigten vor Gesundheitsrisiken zu bewahren.
- Dazu wurde im Zeitraum Mitte Mai bis Mitte Juni eine Onlinebefragung bei knapp 1.300 Beschäf-tigten von Versicherungs- und Vermittlerunternehmen durchgeführt.
Cross-Selling lohnt sich
(2020)
Im Rahmen dieser Arbeit wurde eine Analyse auf Register Transfer Level (RTL) Ebene des
vom Fraunhofer IMS in Verilog entwickelten RV32IM RISC-V Prozessors durchgeführt und der
Configurable Accelerator Engine for Convolution Operations (Caeco) als Hardware-Beschleuniger
für Maschinelles Lernen (ML) integriert. Das Design wurde speziell auf das Lesen von Caecodaten
und auf das Interrupt-Verhalten getestet und verifiziert. Das Schreiben von Caecodaten wurde
zwar auf RTL Ebene simuliert, allerdings nicht auf dem Field Programmable Gate Arrays (FPGA)
verifiziert. Durch einen erarbeiteten Hardware- und Software-Entwicklungsfluss werden beide
Stränge optimiert und parallelisiert. Die Hardware-Entwicklung wurde in eine Gitlab Development
and Operations (DevOps) Umgebung integriert, wodurch das Design im Project Batch Flow Modus
der Vivado 2020.1 IDE automatisiert simuliert, synthetisiert und auf der Entwicklungsplatine
Nexys4 DDR implementiert wird. Die Verifizierungsgrundlage bildet der entwickelte Programm-
Code, der für die RTL Simulation, für die Simulation im Instruktionssimulator riscvOVPsim
der Firma Imperas und dem Debugging des Designs auf dem FPGA genutzt wird. Letzteres
wurde in der Eclipse IDE durchgeführt, wobei der JTAG Olimex ARM-USB-Tiny-H Adapter als
Debug-Schnittstelle eingesetzt worden ist. Die Schnittstelle der beiden Entwicklungsstränge bilden
zwei eigens geschriebene Rust Programme und das Xilinx Programm data2mem, durch die die
kompilierten ELF Dateien in xilinx-kompatible MEM bzw. COE Dateien umgewandelt werden.