TY - THES U1 - Bachelor Thesis A1 - Koray, Cetin T1 - Entwicklung einer Transimpedanzverstärkerschaltung zur Detektion des Einschaltzeitpunktes der Laserdiode einer Time-of-Flight Kamera N2 - Inhalt dieser Arbeit ist der Entwurf und der Aufbau eines Photodiodenverstärkers. Mithilfe der erstellten Platine kann die Detektion von Laserpulsen einer ToF-Ka-mera erfolgen. Dazu werden spezifische Bauteile ausgesucht und mit der Software Cadence simuliert. Anschließend wird die Platine mit der Software Altium Desig-ner entworfen. Als letztes wird die Schaltung auf ihre Funktionalität überprüft und im Zusammenspiel mit der Kamera getestet. Y2 - 2019 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-30527 U6 - https://doi.org/10.26205/opus-3052 DO - https://doi.org/10.26205/opus-3052 SP - 88 S1 - 88 ER - TY - THES U1 - Bachelor Thesis A1 - Wenske, Florian T1 - Entwurf und Validierung eines diskreten Infrarot LEDTreibers für die Charakterisierung von ToF-Kameras N2 - Im Rahmen dieser Bachelorthesis wird ein Infrarot LED-Treiber auf Basis eines PCBs entwickelt, welcher anschließend charakterisiert wird. Die Hauptbestandteile der Schaltung bilden ein MOSFET und eine High-Power IR-LED. Der Fokus liegt hierbei auf der Analyse des zeitlichen Verhaltens der Lichtemission der LED, um die Eignung dieser Schaltung für ToF-Kameras zu untersuchen. Die vorliegenden Messergebnisse werden mithilfe von Simulationen reproduziert, um eine Grundlage für die genauere Prüfung der Einflussfaktoren zu erhalten. Y2 - 2020 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-30609 U6 - https://doi.org/10.26205/opus-3060 DO - https://doi.org/10.26205/opus-3060 SP - 68 S1 - 68 ER - TY - THES U1 - Bachelor Thesis A1 - Tijani, Sofiene T1 - VHDL-Implementierung der Arkussinusfunktion und der Division von Festkommazahlen nach dem CORDIC Algorithmus N2 - Im Rahmen dieser Arbeit werden digitale Schaltungen für die Berechnung von Quotienten und die Auswertung der Arkussinusfunktion entworfen und implementiert. Da diese für die Entwicklung eines kompakten Winkelsensors benötigt werden, wird für die Realisierung der CORDIC-Algotihmus verwendet, welcher die Umsetzung und die Funktionsauswertung mit geringem Hardwareaufwand auf einem FPGA erlaubt. Für die beiden Operationen wird in VHDL jeweils ein Modul entworfen und simuliert und abschließend auf einem Testboard überprüft. Durch die Simulation und die Tests wird die korrekte Funktion des Entwurfs sowie dessen Genauigkeit bei der Berechnung über einen weiten Arbeitsbereich verifiziert. Y2 - 2020 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-29974 U6 - https://doi.org/10.26205/opus-2997 DO - https://doi.org/10.26205/opus-2997 SP - 61 S1 - 61 ER - TY - THES U1 - Master Thesis A1 - Brünger, Fabian T1 - Integration eines Hardwarebeschleunigers für Maschinelles Lernen in einen RISC-V RV32IM Prozessor über Memory-Mapped Register N2 - Im Rahmen dieser Arbeit wurde eine Analyse auf Register Transfer Level (RTL) Ebene des vom Fraunhofer IMS in Verilog entwickelten RV32IM RISC-V Prozessors durchgeführt und der Configurable Accelerator Engine for Convolution Operations (Caeco) als Hardware-Beschleuniger für Maschinelles Lernen (ML) integriert. Das Design wurde speziell auf das Lesen von Caecodaten und auf das Interrupt-Verhalten getestet und verifiziert. Das Schreiben von Caecodaten wurde zwar auf RTL Ebene simuliert, allerdings nicht auf dem Field Programmable Gate Arrays (FPGA) verifiziert. Durch einen erarbeiteten Hardware- und Software-Entwicklungsfluss werden beide Stränge optimiert und parallelisiert. Die Hardware-Entwicklung wurde in eine Gitlab Development and Operations (DevOps) Umgebung integriert, wodurch das Design im Project Batch Flow Modus der Vivado 2020.1 IDE automatisiert simuliert, synthetisiert und auf der Entwicklungsplatine Nexys4 DDR implementiert wird. Die Verifizierungsgrundlage bildet der entwickelte Programm- Code, der für die RTL Simulation, für die Simulation im Instruktionssimulator riscvOVPsim der Firma Imperas und dem Debugging des Designs auf dem FPGA genutzt wird. Letzteres wurde in der Eclipse IDE durchgeführt, wobei der JTAG Olimex ARM-USB-Tiny-H Adapter als Debug-Schnittstelle eingesetzt worden ist. Die Schnittstelle der beiden Entwicklungsstränge bilden zwei eigens geschriebene Rust Programme und das Xilinx Programm data2mem, durch die die kompilierten ELF Dateien in xilinx-kompatible MEM bzw. COE Dateien umgewandelt werden. Y2 - 2020 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-29988 U6 - https://doi.org/10.26205/opus-2998 DO - https://doi.org/10.26205/opus-2998 SP - 150 S1 - 150 ER - TY - THES U1 - Master Thesis A1 - Bouroumiya, Reda T1 - Digital geregelte Frequenzkorrektur eines strahlenharten Relaxations-Oszillators für eine CAN Bittiming Einheit in 65nm CMOS Technologie N2 - Diese Arbeit behandelt den Entwurf und die Implementierung einer Frequenzregelung für den analogen Relaxationsoszillator des im Kontrollsystem des ATLAS-Pixeldetektors eingesetzten CANakari-Controllers des MOPS Chips. Bestehend aus einem Pulszähler, einem PID-Regler, Phasenfehler-Register und einem Control-FSM-Modul, wird das Regelsystem mit dem digital-gesteuerten analogen Oszillator und der Bittiming-Logik verdrahtet. Diese Komponenten können miteinander kommunizieren, Daten austauschen und bilden somit einen geschlossenen Regelkreis. Der Regelalgorithmus beobachtet das eingehende Signal Rx des CAN Busses und verändert die Stellgröße bei entstehender Regelabweichung durch die Detektierung einer fallenden Flanke außerhalb des im CAN Standard definierten Synchronisationssegments, so dass die Taktfrequenz in einem Toleranzintervall stabilisiert wird. Dies gewährleistet, dass es im CAN-Netzwerk nicht zu Synchronisationsfehlern bei der Nachrichtenübertragung kommt. Da es sich um eine gemischte analog/digitale Schaltung handelt, wird das Regelkreis-Verhalten mit Hilfe einer A/MS-Simulationen beurteilt. Die Simulationen dienen einerseits zur Untersuchung wichtiger dynamischer Eigenschaften der Regelstrecke und andererseits zur Beurteilung des Regelkreis-Verhaltens mit den gewählten Regler-Parametern. Y2 - 2021 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-30711 U6 - https://doi.org/10.26205/opus-3071 DO - https://doi.org/10.26205/opus-3071 SP - 122 S1 - 122 ER - TY - THES U1 - Bachelor Thesis A1 - Karaarslan, Remzi T1 - Automatisierte messtechnische Charakterisierung eines Time-to-Digital Converters für eine Time-of-Flight Anwendung N2 - In dieser Bachelorarbeit wird ein Time-to-Digital Converter für eine Time-of-Flight Anwendung untersucht und durch Messungen charakterisiert. Der Time-to-Digital Converter, der von zwei ehemaligen Studenten der Fachhochschule Dortmund entwickelt wurde, ist dafür zuständig, die temperaturbedingte Änderung der Einschaltverzögerung der Lichtquelle, die während den Signalaufnahmen einer Time-of-Flight Kamera entsteht, zu erfassen und die entstandenen Verzögerungen zu korrigieren. Die Aufgabe dieser Arbeit ist es, den entwickelten Testchip mit einer vorentwickelten Platine von Elmos Semiconductor SE zu analysieren und zu überprüfen, ob der Testchip ordnungsgemäß funktioniert. Um den Testchip so aussagekräftig wie möglich zu testen, wird unter Einbindung der Programmiersoftware Qt der Test des TDC automatisiert. N2 - In this bachelor thesis a time-to-digital converter for a time-of-flight application is investigated and characterized by measurement. The Time-to-Digital-Converter, which was developed by two former students of the University of Applied Sciences Dortmund, is responsible to detect the temperature induced change of the turn-on delay of the light source, which occurs during the signal recording of a Time-of-Flight camera, and to correct the resulting delays. The task of this work is to analyze the developed test chip with a pre-developed circuit board from Elmos Semiconductor SE, and to verify the proper function of the test chip. In order to test the test chip as meaningful as possible, the testing of the TDC is automated with the integration of the programming software Qt. Y2 - 2021 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-31017 U6 - https://doi.org/10.26205/opus-3101 DO - https://doi.org/10.26205/opus-3101 ER - TY - THES U1 - Bachelor Thesis A1 - Kiyak, Mehmet T1 - Konfiguration einer GNU RISC-V Toolchain für die Programmierung eines Sipeed Longan Nano Mikrocontroller-Boards in der Eclipse IDE N2 - Diese Arbeit beschäftigt sich mit der Konfiguration der GNU RISC-V Toolchain für die erste Programmierung des Entwicklungsboards Sipeed Longan Nano in der Eclipse Entwicklungsumgebung. In diesem Zusammenhang wurde der Aufbau eines Mikrocontrollers, der Ablauf der Erstellung von Software und die Konfiguration der GNU RISC-V Toolchain für die Programmierung der RGB LED des Entwicklungsboards beschrieben. Dazu gehört das Linker-Script, die Vektortabelle und der Startcode. N2 - This thesis focuses on the configuration of the GNU RISC-V toolchain for the first programming of the development board Sipeed Longan Nano in the Eclipse development environment. In this context, the structure of a microcontroller, the process of creating a software and the configuration of the GNU RISC-V toolchain for programming the RGB LED of the development board were described. This includes the linker script, the vector table and the start code. Y2 - 2021 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-31230 U6 - https://doi.org/10.26205/opus-3123 DO - https://doi.org/10.26205/opus-3123 SP - 81 S1 - 81 ER - TY - THES U1 - Bachelor Thesis A1 - Battai, Abdallah T1 - Steuerung eines Keithley 2400 Sourcemeters über eine RS-232 Schnittstelle mit Hilfe von SCPI Befehlen N2 - Control of a Keithley 2400 Sourcemeters via an RS-232 Interface using SCPI Commands Y2 - 2022 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-32977 U6 - https://doi.org/10.26205/opus-3297 DO - https://doi.org/10.26205/opus-3297 SP - 46 S1 - 46 ER - TY - THES U1 - Bachelor Thesis A1 - Gasmi, Amine T1 - Auslegung eines Tiefsetzstellers mit pulsweitenmodulierter Regelung durch einen Hysterese-Komparator N2 - Die Bachelorthesis beschäftigt sich mit dem Entwurf eines Tiefsetzstellers in einer 180nm CMOS Technologie. Der Fokus liegt auf der Umsetzung einer Regelung, die auf einem Hysterese Verfahren beruht und dafür sorgt, dass der Tiefsetzsteller die erforderliche Ausgangsspannung unabhängig von Störparametern erreicht. Zwei verschiedene Verfahren, die auf einer Welligkeitsinjektionstechnik beruhen, werden vorgestellt und untersucht. Der Tiefsetzsteller wird für eine gegebene Spezifikation ausgelegt und es werden beide Ansätze der Hysterese-Regelung umgesetzt und mit Hilfe der Simulationsresultate verifiziert Y2 - 2022 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-32825 U6 - https://doi.org/10.26205/opus-3282 DO - https://doi.org/10.26205/opus-3282 SP - 29 S1 - 29 ER - TY - THES U1 - Bachelor Thesis A1 - Carpisan, Ümmühan T1 - Programmierung eines ESP32-Mikrocontrollers zur Überwachung einer Batteriespannung über die LoRaWAN Funktechnologie N2 - Im Rahmen dieser Abschlussarbeit wird die Kommunikation in LoRaWAN Funktechnologie getestet. Der Fokus ist hier die Programmierung eines ESP32- Mikrocontrollers, der LoRaWAN-Kommunikationsfähig ist und Spannungswerte an einer Batterie überwacht. Dabei ermöglicht es die Programmierung des ESP32, die Nutzdaten an einen Netzwerkserver zu senden. Der Abruf der Informationen erfolgt über einen Internetzugriff auf den Netzwerkserver. Zum Test wurde ein Labornetzgerät und eine Leiterplatte benutzt. Hierbei wurde die Spannung über einen ADC eingelesen und über LoRaWAN an den Netzwerkserver weitergeleitet. Y2 - 2022 UN - https://nbn-resolving.org/urn:nbn:de:hbz:dm13-33268 U6 - https://doi.org/10.26205/opus-3326 DO - https://doi.org/10.26205/opus-3326 SP - 100 S1 - 100 ER -